研究论文

An Extension of the Verilog-to-Routing Tool to Support Clock Routing via General Routing Channels in FPGA

Safira Adine Kinari, Minoru Watanabe, Nobuya Watanabe

Okayama University

来源International Electronics Symposium (IES)

年份2026

DOI10.1109/ies71033.2026.11702704

原文https://doi.org/10.1109/ies71033.2026.11702704

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学术脉络

学科主题

工程

VLSI and FPGA Design Techniques

Embedded Systems Design Techniques · Interconnection Networks and Systems

参考文献 9

FPGA clock network architecture

Julien Lamoureux, Steven J. E. Wilton · ACM/SIGDA International Symposium on Field-Programmable Gate Arrays (FPGA) · 2006

被引 44

Methodologies for tolerating cell and interconnect faults in FPGAs

Fran Hanchek, Shantanu Dutt · IEEE Transactions on Computers · 1998

被引 106

Architecture and CAD for FPGA Clock Networks

Julien Lamoureux, Steven J. E. Wilton · International Conference on Field Programmable Logic and Applications (FPL) · 2006

被引 3

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FPGA clock network architecture

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被引 44

Methodologies for tolerating cell and interconnect faults in FPGAs

Fran Hanchek, Shantanu Dutt · IEEE Transactions on Computers · 1998

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